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/linux-6.15/drivers/gpu/drm/amd/pm/swsmu/smu13/
H A Daldebaran_ppt.h55 uint8_t pcie_lane[ALDEBARAN_MAX_PCIE_CONF]; member
H A Dsmu_v13_0_7_ppt.c701 pcie_table->pcie_lane[pcie_table->num_of_link_levels] = in smu_v13_0_7_set_default_dpm_table()
1317 (pcie_table->pcie_lane[i] == 1) ? "x1" : in smu_v13_0_7_print_clk_levels()
1318 (pcie_table->pcie_lane[i] == 2) ? "x2" : in smu_v13_0_7_print_clk_levels()
1319 (pcie_table->pcie_lane[i] == 3) ? "x4" : in smu_v13_0_7_print_clk_levels()
1320 (pcie_table->pcie_lane[i] == 4) ? "x8" : in smu_v13_0_7_print_clk_levels()
1321 (pcie_table->pcie_lane[i] == 5) ? "x12" : in smu_v13_0_7_print_clk_levels()
1322 (pcie_table->pcie_lane[i] == 6) ? "x16" : "", in smu_v13_0_7_print_clk_levels()
1325 (lane_width == DECODE_LANE_WIDTH(pcie_table->pcie_lane[i])) ? in smu_v13_0_7_print_clk_levels()
H A Dsmu_v13_0_0_ppt.c703 pcie_table->pcie_lane[pcie_table->num_of_link_levels] = in smu_v13_0_0_set_default_dpm_table()
1328 (pcie_table->pcie_lane[i] == 1) ? "x1" : in smu_v13_0_0_print_clk_levels()
1329 (pcie_table->pcie_lane[i] == 2) ? "x2" : in smu_v13_0_0_print_clk_levels()
1330 (pcie_table->pcie_lane[i] == 3) ? "x4" : in smu_v13_0_0_print_clk_levels()
1331 (pcie_table->pcie_lane[i] == 4) ? "x8" : in smu_v13_0_0_print_clk_levels()
1332 (pcie_table->pcie_lane[i] == 5) ? "x12" : in smu_v13_0_0_print_clk_levels()
1333 (pcie_table->pcie_lane[i] == 6) ? "x16" : "", in smu_v13_0_0_print_clk_levels()
1336 (lane_width == DECODE_LANE_WIDTH(pcie_table->pcie_lane[i])) ? in smu_v13_0_0_print_clk_levels()
H A Dsmu_v13_0.c2505 if (pcie_table->pcie_lane[num_of_levels - 1] < pcie_width_cap) in smu_v13_0_update_pcie_parameters()
2506 pcie_width_cap = pcie_table->pcie_lane[num_of_levels - 1]; in smu_v13_0_update_pcie_parameters()
2511 pcie_table->pcie_lane[i] = pcie_width_cap; in smu_v13_0_update_pcie_parameters()
2517 if (pcie_table->pcie_lane[i] > pcie_width_cap) in smu_v13_0_update_pcie_parameters()
2518 pcie_table->pcie_lane[i] = pcie_width_cap; in smu_v13_0_update_pcie_parameters()
2525 smu_pcie_arg |= pcie_table->pcie_lane[i]; in smu_v13_0_update_pcie_parameters()
/linux-6.15/drivers/gpu/drm/amd/pm/swsmu/smu11/
H A Darcturus_ppt.h55 uint8_t pcie_lane[MAX_PCIE_CONF]; member
H A Dnavi10_ppt.c1350 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 1) ? "x1" : in navi10_emit_clk_levels()
1351 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 2) ? "x2" : in navi10_emit_clk_levels()
1352 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 3) ? "x4" : in navi10_emit_clk_levels()
1353 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 4) ? "x8" : in navi10_emit_clk_levels()
1354 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 5) ? "x12" : in navi10_emit_clk_levels()
1552 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 1) ? "x1" : in navi10_print_clk_levels()
1553 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 2) ? "x2" : in navi10_print_clk_levels()
1554 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 3) ? "x4" : in navi10_print_clk_levels()
1555 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 4) ? "x8" : in navi10_print_clk_levels()
1556 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 5) ? "x12" : in navi10_print_clk_levels()
[all …]
H A Dsienna_cichlid_ppt.c1357 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 1) ? "x1" : in sienna_cichlid_print_clk_levels()
1358 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 2) ? "x2" : in sienna_cichlid_print_clk_levels()
1359 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 3) ? "x4" : in sienna_cichlid_print_clk_levels()
1360 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 4) ? "x8" : in sienna_cichlid_print_clk_levels()
1361 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 5) ? "x12" : in sienna_cichlid_print_clk_levels()
1362 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 6) ? "x16" : "", in sienna_cichlid_print_clk_levels()
1365 (lane_width == dpm_context->dpm_tables.pcie_table.pcie_lane[i]) ? in sienna_cichlid_print_clk_levels()
2164 pcie_table->pcie_lane[0] = max_lane_width; in sienna_cichlid_update_pcie_parameters()
2167 pcie_table->pcie_lane[0] = min_lane_width; in sienna_cichlid_update_pcie_parameters()
2170 pcie_table->pcie_lane[1] = max_lane_width; in sienna_cichlid_update_pcie_parameters()
[all …]
/linux-6.15/drivers/gpu/drm/amd/pm/swsmu/smu14/
H A Dsmu_v14_0_2_ppt.c1193 (pcie_table->pcie_lane[i] == 1) ? "x1" : in smu_v14_0_2_print_clk_levels()
1194 (pcie_table->pcie_lane[i] == 2) ? "x2" : in smu_v14_0_2_print_clk_levels()
1195 (pcie_table->pcie_lane[i] == 3) ? "x4" : in smu_v14_0_2_print_clk_levels()
1196 (pcie_table->pcie_lane[i] == 4) ? "x8" : in smu_v14_0_2_print_clk_levels()
1197 (pcie_table->pcie_lane[i] == 5) ? "x12" : in smu_v14_0_2_print_clk_levels()
1198 (pcie_table->pcie_lane[i] == 6) ? "x16" : in smu_v14_0_2_print_clk_levels()
1199 (pcie_table->pcie_lane[i] == 7) ? "x32" : "", in smu_v14_0_2_print_clk_levels()
1507 pcie_table->pcie_lane[i] = pcie_width_cap; in smu_v14_0_2_update_pcie_parameters()
1513 if (pcie_table->pcie_lane[i] > pcie_width_cap) in smu_v14_0_2_update_pcie_parameters()
1514 pcie_table->pcie_lane[i] = pcie_width_cap; in smu_v14_0_2_update_pcie_parameters()
[all …]
/linux-6.15/drivers/gpu/drm/amd/pm/powerplay/hwmgr/
H A Dsmu7_hwmgr.c3750 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3752 ps->performance_levels[i].pcie_lane; in smu7_get_pp_table_entry_v1()
3754 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3756 ps->performance_levels[i].pcie_lane; in smu7_get_pp_table_entry_v1()
3774 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3779 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3899 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
3904 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
3924 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
3929 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
[all …]
H A Dsmu7_hwmgr.h58 uint16_t pcie_lane; member
H A Dvega10_hwmgr.h142 uint8_t pcie_lane[MAX_PCIE_CONF]; member
H A Dvega12_hwmgr.h120 uint8_t pcie_lane[MAX_PCIE_CONF]; member
H A Dvega20_hwmgr.h173 uint8_t pcie_lane[MAX_PCIE_CONF]; member
H A Dvega10_hwmgr.c1281 pcie_table->pcie_lane[i] = (uint8_t)encode_pcie_lane_width( in vega10_setup_default_pcie_table()
1284 pcie_table->pcie_lane[i] = (uint8_t)encode_pcie_lane_width( in vega10_setup_default_pcie_table()
1577 pp_table->PcieLaneCount[i] = pcie_table->pcie_lane[i]; in vega10_populate_smc_link_levels()
1590 pp_table->PcieLaneCount[i] = pcie_table->pcie_lane[j]; in vega10_populate_smc_link_levels()
/linux-6.15/drivers/gpu/drm/amd/pm/swsmu/inc/
H A Dsmu_v14_0.h85 uint8_t pcie_lane[MAX_PCIE_CONF]; member
H A Dsmu_v11_0.h98 uint8_t pcie_lane[MAX_PCIE_CONF]; member
H A Dsmu_v13_0.h90 uint8_t pcie_lane[MAX_PCIE_CONF]; member
/linux-6.15/drivers/gpu/drm/radeon/
H A Dci_dpm.h43 u16 pcie_lane; member
H A Dci_dpm.c3724 state->performance_levels[0].pcie_lane, in ci_trim_dpm_states()
3726 state->performance_levels[high_limit_count].pcie_lane); in ci_trim_dpm_states()
5435 pl->pcie_lane = r600_get_pcie_lane_support(rdev, in ci_parse_pplib_clock_info()
5464 if (pi->pcie_lane_powersaving.max < pl->pcie_lane) in ci_parse_pplib_clock_info()
5465 pi->pcie_lane_powersaving.max = pl->pcie_lane; in ci_parse_pplib_clock_info()
5466 if (pi->pcie_lane_powersaving.min > pl->pcie_lane) in ci_parse_pplib_clock_info()
5467 pi->pcie_lane_powersaving.min = pl->pcie_lane; in ci_parse_pplib_clock_info()
5475 if (pi->pcie_lane_performance.max < pl->pcie_lane) in ci_parse_pplib_clock_info()
5476 pi->pcie_lane_performance.max = pl->pcie_lane; in ci_parse_pplib_clock_info()
5477 if (pi->pcie_lane_performance.min > pl->pcie_lane) in ci_parse_pplib_clock_info()
[all …]